Pour développer notre pôle microélectronique, ELSYS Design recherche un(e) ingénieur(e) spécialisé dans vérification d’ASICs avec la méthodologie UVM.
En tant qu’Ingénieur(e) Vérification Digitale, vous serez amené(e) à travailler sur des projets challengants sur les chips de génération future dans le secteur du semiconducteur.
Vos missions :
· Analyser les exigences systèmes et les documentations d’architecture du chip
· Planifier les activités de vérification pour des IPs spécifiques
· Intervenir sur la partie Design (description RTL, développement C, tests unitaire, intégration)
· Ecriture des tests benchs au niveau IP en utilisant la méthodologie UVM
Diplômé d’un BAC+5 en électronique, vous justifiez d’une ou plusieurs expériences significatives en vérification d’ASICs/FPGA avec la méthodologie UVM
Compétences recherchées et/ou à développer :
· Maîtrise du flot de développement ASIC
· Maîtrise de langage de description RTL (VHDL, Verilog, SystemVerilog)
· Maitrise de la vérification de System-on-Chip (Soc) en utilisant la méthodologie UVM
· Utilisation de Git, SVN
· Méthodologie du cycle en V / Agile
Qualités requises :
· Savoir travailler en équipe et avoir le sens du service
· Savoir communiquer avec différents types d'interlocuteurs
· Bonne maîtrise de l'anglais technique
Nous recherchons des ingénieur·e·s motivé·e·s par les challenges techniques, désireux.euses de travailler sur des projets diversifiés, et aspirant à poursuivre dans l'expertise.
Si vous êtes sympa et passionné, que vous souhaitez rejoindre une équipe dynamique de passionnés alors n'hésitez pas à postuler !
31k €/an
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